芯片失效性分析，国标盐雾试验标准
每个CLB包含一个触发器，允许FPGA实现锁存器，状态机和其他有状态电路。下图显示了触发器的实现。它使用主/辅助设计。当时钟为低电平时，个多路复用器让数据进入主锁存器。当时钟变高时，多路复用器关闭个锁存器的环路，并保持该值。（该位通过“或”门，“与非”门和反相器两次反转，因此保持不变。）同时，当时钟变高时，辅助锁存器的多路复用器从个锁存器接收该位（请注意，时钟已反转）。该值成为触发器的输出。当时钟变低时，次级的多路复用器关闭环路，从而锁存该位。因此，触发器是边缘敏感的，在时钟的上升沿锁存该值。置位和复位线强制触发器为高电平或低电平。
触发器的实现，箭头指出了个多路复用器和两个OR-NAND门
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8-pin 交换矩阵
交换矩阵是一个重要的路由元件。每个开关有八个"引脚"（每侧两个），几乎可以连接任意引脚组合在一起。这允许信号比单个路由节点更灵活地转动、拆分或交叉。下图显示了四个CLB （cyan）之间的路由网络的一部分。交换矩阵（绿色）可与右侧连接的任意组合连接。请注意，每个引脚可以连接到其他 7个引脚中的 5 个。例如，引脚 1 可以连接到引脚 3，但无法连接到引脚 2 或4。这使得矩阵几乎是一个横栏，有20个潜在的连接，而不是28个。